1 module addr_generator( 2 input clk, 3 input nrst, 4 output[7:0] inc_addr 5 ); 6 reg[7:0] inc_addr_reg; 7 assign inc_addr[7:0] = inc_addr_reg[7:0]; 8 always @(posedge clk or negedge nrst) 9 begin 10 if(!nrst) 11 inc_addr_reg[7:0] <= 8'd0; 12 else 13 inc_addr_reg[7:0] <= inc_addr_reg[7:0] +1'b1; 14 end 15 endmodule 双口RAM存储地址生成电路